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2비트 오류정정 능력을 가진 블록코드 디코더의 H/W 및 S/W 구현에 관한 연구 = Implementation of block code decoder for double-error correction in H/W and S/W
서명 / 저자 2비트 오류정정 능력을 가진 블록코드 디코더의 H/W 및 S/W 구현에 관한 연구 = Implementation of block code decoder for double-error correction in H/W and S/W / 전봉신.
저자명 전봉신 ; Jeon, Bong-Shin
발행사항 [대전 : 한국과학기술원, 1997].
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서울 학위논문 서가

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초록정보

In this thesis, H/W and S/W implementations of decoders using block codes for random error correction are described and the performance of the codes is obtained. These can mainly be used in space communication or mobile telephones. We implement a decoder for the(63,48) cyclic code using the FPGA, XC3064. Moreover we introduce the block of a digital PLL which reduces the phase margin, and is really useful for designing a decoding circuit. By implementing using S/W algorithm, complex logic circuits are eliminated and then we can easily construct a compact-sized products. The data rate of 2400 bps and the carrier frequency of 800MHz are used for evaluation of the performance. The Bit Error Rate(BER) performance of the decoding algorithm is about 2dB superior to that of the uncoded case.

서지기타정보

서지기타정보
청구기호 {MICE 97024
형태사항 iv, 58 p. : 삽도 ; 26 cm
언어 한국어
일반주기 저자명의 영문표기 : Bong-Shin Jeon
지도교수의 한글표기 : 이황수
지도교수의 영문표기 : Hwang-Soo Lee
학위논문 학위논문(석사) - 한국과학기술원 : 정보및통신공학과,
서지주기 참고문헌 : p. 57-58
주제 블록코드
순회부호
부호화와 복호화
디지털 위상고정루프
복호 알고리즘
Block code
Cyclic Code
Encoding and decoding
Digital PLL
decoding algorithm
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