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Memory-side cache-based rowhammer protection scheme = 메모리 측 캐시 기반 로우해머 보호 방안
서명 / 저자 Memory-side cache-based rowhammer protection scheme = 메모리 측 캐시 기반 로우해머 보호 방안 / Sanzhar Shabdarov.
발행사항 [대전 : 한국과학기술원, 2024].
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8042177

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학술문화관(도서관)2층 학위논문

MEE 24065

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초록정보

The continuous advancement of DRAM technology has significantly increased memory capacity and performance, but it has also introduced challenges related to reliability. The Rowhammer threat has been demonstrated to have severe implications, including system crashes, and elevation of attacker process privileges. The increasing vulnerability of newer DRAM generations raises the seriousness of the Rowhammer threat even further. This study introduces an innovative memory-side cache-based mitigation against Rowhammer at-tacks that is uncontrolled by the CPU and is applicable to any DDR-based memory systems. We explore the design space of creating an entirely cache-based mitigation and, also, analyze the possibility of combining the cache with in-DRAM Rowhammer mitigations. We show that, although cache-only Rowhammer prevention has no performance overhead compared to the prior works, it has a significant hardware overhead for low Rowhammer threshold values, diminishing its attractiveness. However, the combination of the memory-side cache and Mithril, a prior work, is demonstrated to be effective in both reducing the overall hardware overhead of the cache and reducing the performance degradation of Mithril from 7.3% to 3% at the Rowhammer threshold of 256.

DRAM 기술의 지속적인 발전은 메모리 용량과 성능을 크게 향상했지만, 신뢰성과 관련된 도전도 동시에 가져왔습니다. 로해머(Rowhammer) 위협은 계획되지 않은 시스템 종료 및 공격자 프로세스 권한 상승과 같은 심각한 영향을 보여왔습니다. 더 최신 DRAM 세대에서 해당 취약성이 더 심해짐으로 로해머 위협의 심각성을 또한 더욱 높여지고 있습니다. 본 연구는 CPU의 제어가 필요 없으며, 모든 DDR 기반 메모리 시스템에 적용할 수 있는 혁신적인 메모리 측면 캐시 기반 로해머 공격 대응책을 소개합니다. 우리는 캐시 기반 대응책의 설계 공간을 탐색하며, DRAM 내부 캐시의 로해머 대응책과 결합할 가능성도 분석합니다. 우리는 캐시만 사용한 로해머 방지가 이전 연구와 비교해 성능 오버헤드가 없지만, 낮은 로해머 임곗값에 대해서는 상당한 하드웨어 오버헤드를 가지고 있어 매력을 줄이는 것으로 나타났습니다. 그러나 메모리 측면 캐시와 이전 연구인 Mithril을 결합하는 것이 캐시의 전반적인 하드웨어 오버헤드를 줄이고, 로해머 임곗값이 256인 경우 Mithril에 의한 성능저하를 7.3

서지기타정보

서지기타정보
청구기호 {MEE 24065
형태사항 iv, 26 p. : 삽도 ; 30 cm
언어 영어
일반주기 저자명의 한글표기 : 샤브다로브산자르
지도교수의 영문표기 : Dongjun Kim
지도교수의 한글표기 : 김동준
Including appendix
학위논문 학위논문(석사) - 한국과학기술원 : 전기및전자공학부,
서지주기 References : p. 22-24
주제 Hardware Security
Rowhammer
Computer architecture
DRAM
Cache
하드웨어 보안
로해머
컴퓨터 아키텍처
DRAM
캐시
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