서지주요정보
S-band에서 동작하는 PLL을 이용한 주파수 합성기의 설계 및 제작 = Design and implementation of a phase-locked frequency synthesizer at S-band(2.225 - 2.23GHz)
서명 / 저자 S-band에서 동작하는 PLL을 이용한 주파수 합성기의 설계 및 제작 = Design and implementation of a phase-locked frequency synthesizer at S-band(2.225 - 2.23GHz) / 윤병수.
저자명 윤병수 ; Yun, Byeong-Soo
발행사항 [대전 : 한국과학기술원, 1996].
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8006263

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MEE 96048

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초록정보

A frequency synthesizer is designed and implemented by using PLL (Phase-Locked Loop) at S-band(2.225 ~ 2.23GHz) with 160kHz steps. This system consists of a reference oscillator, a phase detector, a loop filter, a VCO(Voltage-Controlled Oscillator), and a frequency divider. In this thesis VCO and a loop filter are designed and fabricated, and one-chip PLL IC(Fujitu, MB1508) including a phase detector and a frequency divider(a dual-modulus prescaler) is used. VCO using a high-Q dielectric resonator yields 10dBm output power and a flat frequency response of 5.15MHz/V gain. The frequency stability of the frequency synthesizer is less than 0.5ppm. Output power of that is about 7dBm.

서지기타정보

서지기타정보
청구기호 {MEE 96048
형태사항 iii, 54 p. : 삽도 ; 26 cm
언어 한국어
일반주기 저자명의 영문표기 : Byeong-Soo Yun
지도교수의 한글표기 : 최순달
지도교수의 영문표기 : Soon-Dal Choi
학위논문 학위논문(석사) - 한국과학기술원 : 전기 및 전자공학과,
서지주기 참고문헌 : p. 53-54
주제 전압조정발진기
주파수합성기
S-band
VCO
PLL
Frequency sythesizer
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