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(A) hierarchical schematic capture system for VLSI design = VLSI 설계를 위한 계층적인 개략도 인식 시스템
서명 / 저자 (A) hierarchical schematic capture system for VLSI design = VLSI 설계를 위한 계층적인 개략도 인식 시스템 / Young-Sub Ahn.
발행사항 [서울 : 한국과학기술원, 1987].
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MEE 8744

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초록정보

Program celled HIENA (Hierarchical Interactive Entry and Netlist Analysis) for schematic editing and extraction of electrical netlist has been developed to provide an integrated VLSI design environment based on EDIF under MS-DOS Version 3.0 on IBM PC AT. HIENA consists of three subprograms, SCHEMA, CONE, and HILINK; SCHEMA (SCHEMAtic editor) handles interactive schematic design entry and editing, and CONE (CONnectivity Extractor) extracts the connectivity information, i.e., netlist of each page drawn with SCHEMA, and HILINK (HIerarchical LINKer) is responsible for linking multiple pages with design hierarchy preserved and for providing the netlist information in EDIF format.

집적회로 설계 자동화 시스템을 일반 기업체 및 각 학교에 널리 보급하기 위하여 종합적인 설계 자동화 시스템을 개인용 컴퓨터상에 구축하고자 하는 프로젝트의 한 분야로서 계층적 설계가 가능한 schematic 회로 설계 시스템이 개발되었다. 현재 이 프로젝트를 위하여 여러가지의 프로그램들이 개발되었거나 개발중에 있으며 모든 프로그램이 IBM 개인용 컴퓨터상에서 사용 가능하도록 되어 있다. 이번에 개발된 schematic 회로 설계 시스템은 모두 세 개의 프로그램으로 구성되어 있으며, 이 시스템으로부터 나오는 출력은 이번 프로젝트에 속한 어느 프로그램에서나 사용 가능하도록 통일된 형식을 갖추고 있다. 이 시스템의 구성을 보면, 첫번째 프로그램(SCHEMA)은 컴퓨터 그래픽스를 이용하여 사용자가 쉽게 자신의 회로를 설계할 수 있도록 되어 있고, 두번째 프로그램(CONE)은 설계한 회로 내에서 회로 구성 요소간의 상호 연결 관계를 알아내는 기능을 갖추고 있으며, 마지막 세번째 프로그램(HILINK)은 계층적 설계를 하였을 경우 각 계층간의 상호 관계를 파악하여 다른 프로그램에서 필요로 하는 전체 회로의 연결 관계에 관한 정보를 만들어 파일에 저장한다. 모든 프로그램이 C 프로그램 언어로 되어 있으며 현재 IBM 개인용 컴퓨터상에서 사용되고 있다.

서지기타정보

서지기타정보
청구기호 {MEE 8744
형태사항 1책(면수복잡) : 삽화 ; 26 cm
언어 영어
일반주기 Appendix : A, EDIF structure. - B, Error messages
저자명의 한글표기 : 안영섭
지도교수의 영문표기 : Chong-Min Kyung
지도교수의 한글표기 : 경종민
학위논문 학위논문(석사) - 한국과학기술원 : 전기및전자공학과,
서지주기 Includes references
주제 Logic design.
VLSI. --과학기술용어시소러스
논리 설계. --과학기술용어시소러스
계층 구조 시스템. --과학기술용어시소러스
Integratd circuits --Very large scale integration.
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